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記事検索結果
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京都市で開かれた半導体の国際学会「VLSI回路シンポジウム」で発表した。 従来はアナログ回路とデジタル回路で構成していた高周波発振器を全てデジタル化すると、回路面積は小さくなるが、W...
新LSIはアナログ回路で上下のパネルの抵抗値の変化を検知し、内蔵のCPUが2点の座標分離を演算処理することで2点検出を可能にした。
デジタル回路とアナログ回路を組み合わせた位相同期回路(PLL)を使い、CMOSに適した品質の良い周波数変調連続波(FMCW)信号を出力できるように作り込んだ。 ...
アナログ回路の小型化につながるのが特徴で、今後は他センサー向けICなどにも適用を広げる。 ... 同社では同110ナノメートルのCMOSプロセスはあるが、同電圧が1・2ボルトと小さく、アナログ...
【立川】モーデック(東京都八王子市、嶌末政憲社長、042・656・3360)は、アナログ回路のシミュレーションソフト評価システム「VELEADE Ver1・2=写真」を...
新日本無線の持つコントロール部とパワー部を一体化したモノリシックICを形成するBCDプロセスを、UMCJの8インチウエハーの回路線幅0・35マイクロメートル(マイクロは100万分の1)...
アナログ回路を使わず、ICを完全デジタル化し、動画などの大容量データを数秒ほどでダウンロード、開発期間も従来比半分に短縮できる。... 送受信ICは通常、アナログ回路を使い、高速化とともに波長のズレな...
台湾で開催中の半導体関連の国際学会「アジア固体回路会議(A―SSCC)」で18日発表する。 ... 素子の配列や周辺回路の設計を最適化し、電流比を向上して読み出し性能を高めた。...
【横浜】エヌエフ回路設計ブロックは太陽光発電や燃料電池といった環境エネルギーが体系的に学べる実習プログラムの販売を始めた。... 応用実習では回路設計・製作、プログラミングが学べる。 ... ...
東芝は、2009年度中の量産を見込む0・13マイクロメートル世代高耐圧アナログ混載プロセス技術を開発した。... 特に25ボルト以上の高耐圧領域では、素子分離法(STI/DTI...
NECエレクトロニクスは、90ナノメートル(ナノは10億分の1)世代の微細CMOSプロセスに対応する新アナログ回路技術を開発した。... 「VLSI回路シンポジウム」で18日発表する。...
NECエレクトロニクスは29日、チップ上の回路線幅に90ナノメートル(ナノは10億分の1)プロセスを採用したDRAM混載LSI「μPD809400」を製品化したと発表した。... 8メ...
こうした課題に対し、群馬県では産学官が連携してアナログ技術を基にした産業集積地に導く取り組みを進めており、その一つが県が主体となり実施しているアナログ技術者講座「群馬アナログカレッジ」だ。... また...
太陽誘電は回路設計者向けに電子部品選定を支援するソフトウエア「太陽誘電コンポーネンツセレクションガイドアンドデータライブラリ」の提供を始めた。... 高周波回路を設計する際、回路設計シミュレーションに...
アナログ回路を解析するソフト「DDRA=写真」は27万900円から。デジタル回路を対象とした解析モジュール「TLA7BB4型」は743万4000円から。 ... データ転送速度が毎秒1...
半導体はアナログ回路とデジタル回路を混載した製品を増やすほか、環境負荷が少ないベアチップを基板に実装したモジュール製品を伸ばす。
開発したのはソフトウエア無線システムで要となる「アナログベースバンドLSI」。複数のアナログ回路を組み合わせていた従来の可変機能を高速デジタル信号を用いて、一つのフィルターで動作できるようにした。
